用于二进制标志确定的设备和方法
发布时间：2025-07-04 16:20:54 人气：8
用于二进制标志确定的设备和方法
专利类型：
发明授权
申请(专利)号：
CN202011080609.6
申请日：
2020-10-10
授权公告号：
CN112653448B
授权公告日：
2025-07-04
申请人：
意法半导体(格勒诺布尔2)公司; 意法半导体(鲁塞)公司
地址：
法国格勒诺布尔
发明人：
专辑：
信息科技
专题：
无线电电子学
主分类号：
H03K19/20
分类号：
H03K19/20
国省代码：
FR0ISGNB
页数：
13
代理机构：
北京市金杜律师事务所
代理人：
董莘
优先权：
2019-10-11 FR 1911347
主权项：
1.一种操作中央处理单元CPU中的算术和逻辑单元ALU电路的方法,所述方法包括：由所述ALU电路中的算术运算电路将第二掩蔽数据和第三掩蔽数据相加以获得第一掩蔽二进制数据；由所述算术运算电路将对应于所述第二掩蔽数据的第二掩码和对应于所述第三掩蔽数据的第三掩码相加,以获得对应于所述第一掩蔽二进制数据的第一掩码；由所述算术运算电路向所述ALU中的标志生成器电路提供所述第一掩蔽二进制数据和所述第一掩码；由所述标志生成器电路中的第一比较器电路将所述第一掩蔽二进制数据和所述第一掩码进行比较；以及由所述标志生成器电路中的异或逻辑门在不揭露所述第一掩蔽二进制数据的情况下,通过以下公式中的一个公式确定所述第一掩蔽二进制数据的进位数字指示符位：Flag-C＝CD1-M xor CD2-M xor CADD-D-M xor CADD-MD xor CD-M；或Flag-C＝CD1-M+CD2-M+CADD-D-M-CADD-MD-CD-M其中：Flag-C表示所述进位数字指示符位；“xor”表示异或逻辑运算；“+”表示加法运算；“-”表示减法运算；CD1-M表示第一进位数字,所述第一进位数字在得到所述第二掩蔽数据的掩蔽操作期间能够出现；CD2-M表示第二进位数字,所述第二进位数字在得到所述第三掩蔽数据的掩蔽操作期间能够出现；CADD-D-M表示第三进位数字,所述第三进位数字在所述第二掩蔽数据和所述第三掩蔽数据的所述相加期间能够出现；CADD-MD表示第四进位数字,所述第四进位数字在所述第二掩码和所述第三掩码的所述相加期间能够出现；以及CD-M表示第五进位数字,所述第五进位数字在得到所述第一掩蔽二进制数据的掩蔽操作期间能够出现。
摘要：
本公开的各实施例涉及用于二进制标志确定的设备和方法。一种用于确定第一二进制数据的进位数字指示符位的实施例方法,包括用于通过掩蔽操作而被掩蔽的第一二进制数据的处理的步骤,并且不包括第一二进制数据的任何处理步骤。
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